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Dual 50MHz to 1000MHz High-Linearity,
Serial/Parallel-Controlled Analog/Digital VGA
Table 3. SPI Data Format (continued)
FUNCTION
Digital Attenuator State 2
(Path 1)
Digital Attenuator State 1
(Path 1)
On-Chip DAC
(Path 1)
BIT
D17
D16
D15
D14
D13
D12
D11
D10
D9
D8
D7
D6
D5
D4
D3
D2
D1
D0 (LSB)
MSB
DESCRIPTION
16dB step (MSB of the 5-bit word used to program the Path 1 digital attenuator state 2)
8dB step
4dB step
2dB step
1dB step
16dB step (MSB of the 5-bit word used to program the Path 1 digital attenuator state 1)
8dB step
4dB step
2dB step
1dB step
Bit 7 (MSB) of on-chip DAC used to program the Path 1 analog attenuator
Bit 6 of DAC
Bit 5 of DAC
Bit 4 of DAC
Bit 3 of DAC
Bit 2 of DAC
Bit 1 of DAC
Bit 0 (LSB) of DAC
LSB
DAT
DN
D(N-1)
D1
D0
CLK
t CW
CS
t CS
t CH
t ES
t EWS
t EW
NOTES : DATA ENTERED ON CLOCK RISING EDGE.
ATTENUATOR REGISTER STATE CHANGE ON CS RISING EDGE.
N = NUMBER OF DATA BITS.
Figure 1. SPI Timing Diagram
20
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